Modul 06 Proyek Perancangan Rangkaian Di
Modul 06 Proyek Perancangan Rangkaian Di
2
Raden Fajar Hadria Putra (13511076)
Yosafat Marthin Samosir (18011053)
Asisten: Fajar Arief P. (13209099)
Tanggal Percobaan: 6/12/2012
EL2195-Praktikum Sistem Digital
Laboratorium Dasar Teknik Elektro - Sekolah Teknik Elektro dan Informatika ITB
Abstrak
Percobaan kali ini adalah percobaan
perancangan dan pelaksanaan proyek
pembuatan rangkaian digital. Percobaan
ini terdiri dari beberapa bagian, yaitu
desain, implementasi, dan pengujian
sistem yang dibuat. Rangkaian digital
yang dibuat memiliki FSM yang terdiri
dari sedikitnya 3 blok. Perancangan
rangkaian
menggunakan
VHDL.
Interface yang dapat digunakan berupa
VGA, sound card, USB, koneksi serial,
atau lainnya yang ada di board FPGA.
Kata kunci: FPGA, FSM, VGA, VHDL.
1. PENDAHULUAN
Setelah praktikum-praktikum yang telah
dilakukan, pada praktikum kali ini praktikan
diminta untuk menggunakan apa yang telah
dipelajari
dalam
praktikum-praktikum
sebelumnya. Praktikan diminta untuk dapat
membuat proyek yang memiliki desain dan
implementasi VHDL karya praktikan sendiri.
Kemudian dilakukan praktikum proyek ini
dengan tujuan :
Menspesifikasikan
mendeskripsikan
sederhana.
sistem
dan
digital
2. TEORI DASAR
2.1
FPGA
Field-Programmable
Gate
Array
(FPGA)
adalah
komponen
elektronika
dan
semikonduktor yang mempunyai komponen
gerbang terprogram (programmable logic)
dan sambungan terprogram. Komponen
gerbang terprogram yang dimiliki meliputi
jenis gerbang logika biasa (AND, OR, XOR,
NOT) maupun jenis fungsi matematis dan
kombinatorik yang lebih kompleks (decoder,
adder, subtractor, multiplier, dll). [1].
2.2
VHDL
VHDL
merupakan
sebuah
bahasa
pemrograman
yang
digunakan
untuk
mendeskripsikan hardware. VHDL merupakan
singkatan dari VHSIC (Very High Speed
Integrated Circuit) Hardware Description
Language.. Manfaat utama dari VHDL ketika
digunakan untuk mendesain sebuah sistem
adalah kemampuannya untuk memodelkan
sistem tersebut serta mensimulasikannya
sebelum synthesis tools mentranslasikannya
ke hardware, [2].
2.3
FINITE-STATE MACHINE
2.4
VGA
2.5
DESKRIPSI PROYEK
ini
peralatan
yang
3.1
Monitor LCD.
PENGERJAAN PROYEK
3.2
PROSES DESAIN
3.3
STRATEGI PENGUJIAN
4.2
Gambar 4.1 Hasil Simulasi Input Uang 500
HASIL IMPLEMENTAS
4.3
Seperti
yang
telah
disebutkan,
hasil
implementasi tidak sesuai harapan seperti
ide dan spesifikasi yang praktikan buat. Input
yang di-assign dalam sistem tidak berjalan
sama sekali dan inisialisasi saat diprogram
masih salah. Poin-poin yang sesuai dengan
spesifikasi adalah tampilan layar secara
penuh dan switch reset yang berhasil
membuat layar menjadi hitam, yaitu state
awal yang seharusnya.
4.4
Praktikan
dapat
menganalisis
kesalahan-kesalahan
yang
mengakibatkan
gagalnya
sistem
memenuhi spesifikasi.
6. PEMBAGIAN KERJA
Raden Fajar Hadria Putra :
-
Membuat
dan
memodifikasi
kode VHDL untuk sistem
Kesalahan
dalam
inisialisasi
state, karena saat layar pertama
diprogram initial statenya tidak
sesuai dengan initial state yang
seharusnya hanya menampilkan
warna hitam.
Gagalnya
input
untuk
mempengaruhi variabel. Sama
seperti kemungkinan pertama,
namun untuk kemungkinan kali
ini input uanglah yang tidak
memberi pengaruh terhadap
variabel.
Memberi
template
membuat kode VHDL
untuk
DAFTAR PUSTAKA
[1]
http://id.wikipedia.org/wiki/FPGA
[2]
http://imansutarno.blogspot.com/20
10/10/vhdl.html,
[3]
http://v3.juhara.com/id/artikel/pemr
ograman-delphi/16-object-orientedfinite-state-machine
[4]
http://wahanaava.blogspot.com/201
2/06/vga-adalah-kepanjangan-darivideo.html
5. KESIMPULAN
Ada beberapa kesimpulan dari modul
bagian 2 ini, diantaranya :
color_rom.vhd
hitunguang.vhd