INTRODUCCIN
La multiplicacin, la suma y la resta de dos Nmeros binarios se Hace con papel y
lpiz Por Adiciones sucesivas y corrimientos. Los circuitos multiplicadores hijo
ampliamente Usados en Sistemas Digitales, Estos Sistemas pueden Ser
implementados en Diversas Formas, ya mar en forma combinacional, en forma
secuencial Mediante el USO de registros y contadores o Mediante el USO DE UN
Arreglo lgico programable (PLA), ESTO de Acuerdo de Recursos y Posibilidades.
La multiplicacin de nmeros binarios se Lleva un cabo de la Misma forma de la del
que multiplicacin de nmeros Decimales. En Realidad El Proceso es ms simple,
ya Que las Cifras multiplicadoras hijo 0 o 1, de Modo Que Siempre se multiplica Por
cero o por Uno y no hay Cifras Otras POR.
II.
-
OBJETIVO
Se deber implementar y disear una calculadora bsica aadiendo los
componentes antes estudiados como el sumador y restador.
III.
MATERIALES
3 Protoboard.
1 Regulador de tensin 5V - LM7805.
1 Circuito Integrado TTL 7483, 7447, 7486, 7486.
1 Display nodo Comn.
1 m. de cable PAR telefnico o cable UTP.
1 Manual TTL/CMOS.
1 Diodo led rojo.
2 Dip swith de 4p.
1 pulsador de 2p.
2 Resistencias de 320.
9 Resistencias de 1K
III.
MARCO TERICO
3.1. Semisumador
Se denomina semisumador al circuito combinacional capaz de realizar la
suma
Aritmtica binaria de dos nicos bits A y B, proporcionando a su salida un bit
resultado de suma S y un bit de acarreo Co. En la siguiente figura se muestra la
tabla de verdad de este circuito con sus funciones, acompaado de un esquema del
Half-Adder.
Este dispositivo nos ofrece una mejora del semisumador al cual se le aade
unacarreo de entrada. De esta manera podemos afrontar sumas de ms de un bit
para las cuales utilizaremos el acarreo de salida del anterior en el acarreo de
entrada del siguiente. As completamos la suma correctamente.
A continuacin vemos la tabla de verdad y un esquema.
Dado que podemos expresar la suma de dos bits con la operacin XOR, podemos
expresar la suma de dos bits y un acarreo de la siguiente forma:
b.
sea 1.
De all se obtiene lo siguiente simplificando a travs de mapas de
Karnaugh
Nota:
Tambin es posible implementar el sumador completo utilizando dos circuitos
semisumadores. El primer semisumador suma los dos bits, el segundo suma el
resultado con el acarreo de entrada. Habr acarreo de salida si cualquiera de los
dos
semisumadores genera un acarreo.
SUMADOR COMPLETO
A y B = Entrada de datos
C = Carrier de entrada FS = Funcin de Suma FC = Funcin de
Carrier
A
0
0
0
0
1
1
1
1
B
0
0
1
1
0
0
1
1
SALIDA
FA
0
1
1
0
1
0
0
1
FB
0
0
0
1
0
1
1
1
Donde FC = BC+AC+AB FS = A + B +C
B. Diseo de un sumador completo de
1 bit
C. Implementacin
La tecnologa a utilizar es TTL (Lgica Transistor a Transistor), el
circuito integrado utilizar es 7483.
Entrada
Salida
Sistema
B
S
sumador
Control
Donde:
A y B = Entrada de datos
S = Bit de Signo
FS = Funcin de Suma
FC = Funcin de Carrier
. Anlisis Restador de 1 bit
S
B
Donde
0
0
0
1
1
0
1
1
F
0
1
1
0
F = S+ B
FS
FC
DISEO DE UN MULTIPLICADOR
El multiplicador Para observar como puede implantarse un arreglo multiplicador
con un circuito combinatorio consideremos al multiplicacin de dos nmeros de 2 bits.
Los bits del multiplicando son C y D, los bits del multiplicador son A y B, mientras que el
producto es X0 X1, X2 y X3.
El primer producto parcial se forma al multiplicar D por AB.
La multiplicacin de dos bits D y A produce un 1 si los dos digitos son 1; de otra manera
produce un 0.
Esto es identico a una operacin AND y puede lograrse con una compuerta AND; en el
diagrama veremos que el primer producto parcial se forma mediante dos compuertas
AND.
El segundo producto parcial se forma al multiplicar C por AB y se recorre una posicin a
la izquierda.
Los dos productos parciales se suman con dos circuitos semisumadores.
Por lo general hay ms bits en los productos parciales y ser necesario utilizar
sumadores completos para producir la suma.
Notese que el bit menos significativo no tiene que recorrer un sumador por que est
formado por la salida de la primera compuerta AND.
IV.
CONCLUSIONES
Se cumplieron las metas establecidas concretando satisfactoriamente la
V.
REFERENCIAS BIBLIOGRFICAS
-http://fisica.udea.edu.co/~labgicm/Curso%20de%20circuitos%20logicos/2013_Clase_sumador%20completo.p
df
http://serdis.dis.ulpgc.es/~itis-sd/Transparencias0607/Tema13.pdf