Trabalho apresentado Universidade Castelo Branco como requisito parcial para aprovao
em A2 na disciplina de Introduo Computao.
TERMO DE AVALIAO:
NOTA: _____________
1. INTRODUO......................................................................................................................6
2. ARQUITETURA RISC E CISC.............................................................................................7
2.1. CARACTERSTICAS....................................................................................................8
2.1.1. Arquitetura RISC.....................................................................................................8
2.1.2. Arquitetura CISC.....................................................................................................8
2.2. PRINCIPAIS DIFERENAS..........................................................................................9
2.3 VANTAGENS E DESVANTAGENS.............................................................................10
2.3.1. Vantagens...............................................................................................................10
2.3.2. Desvantagens.........................................................................................................10
4. CONCLUSO......................................................................................................................12
5. REFERNCIAS BIBLIOGRFICAS..................................................................................13
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1. INTRODUO
Desenvolvida pela IBM, nos anos 70, a tecnologia RISC (Reduced Instruction Set
Computing) baseou-se num conjunto reduzido de instrues simplificadas, definindo apenas
as mais utilizadas, todavia evitando utilizar microcdigos. As operaes enfatizam o uso de
registradores, sendo o acesso memria limitado a instrues do tipo load/store,
consequentemente o processador gastaria apenas um ciclo por instruo. Porm, havia
dificuldades na utilizao de programas complexos com um conjunto reduzido de instrues.
Este conjunto acabou incrementado com novas instrues, como as necessrias para trabalhar
com multiprocessamento, memria virtual, etc.
A tecnologia CISC (Complex Instrution Set Computing) uma linha de arquitetura de
processadores capaz de executar muitas instrues complexas diferentes. Os processadores
baseados nessa arquitetura possuem um conjunto de cdigos de instrues que so gravados
no processador, permitindo o recebimento das instrues do programa e as execute. Alm
disso, a arquitetura CISC, tpica de ambientes comerciais, no oferece a velocidade necessria
aos trabalhos com extensas utilizaes de nmeros e grficos. Diversos fatores que
contribuem para o aumento da velocidade de um processador RISC no so inerentes a esta
tecnologia, como uso de cache, pipeline de instrues e muitos registradores na CPU, sendo
que estes recursos tambm so usados em mquinas CISC.
Visando promover o uso da arquitetura CISC, algumas razes se destacam:
Reduo das dificuldades de escrita de compiladores;
Facilidade na deteco e correo de erros;
Reduo dos custos de desenvolvimento de software;
Melhor compactao do cdigo;
Reduo do custo global do sistema;
Reduo da diferena semntica entre linguagens de programao e mquina;
Reduo drstica do software do sistema;
Eficincia na execuo dos programas escritos em linguagens de alto nvel.
A transio de CISC para RISC revolucionou a arquitetura dos computadores, onde os
conjuntos de instrues foram mudados, sacrificando a compatibilidade binria para o
desempenho. Ao se reduzir o conjunto de instrues, o tamanho do chip em que o processador
cabia tambm foi reduzido, permitindo o aumento da velocidade do clock e que o processador
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2.1. CARACTERSTICAS
RISC CISC
Instrues simples e em nmero reduzido Muitas instrues complexas
Instrues de tamanho fixo Instrues de tamanho varivel
Poucos modos de endereamento Muitos modos de endereamento
Apenas instrues load/store podem acessar a Muitas instrues podem acessar a memria
memria
Mltiplos conjuntos de registradores nico conjunto de registradores
Complexidade no compilador Complexidade no cdigo
Trs operandos de registradores permitidos Um ou dois operandos de registradores
por instruo permitidos por instruo
Passagem eficiente de parmetros por Passagem de parmetros ineficiente atravs
registradores no processador da memria
Instrues de um nico ciclo Instrues de mltiplos ciclos
Instrues executadas pelo hardware Instrues interpretadas pelo microprograma
Altamente pipelined Pouco ou nenhum pipelined
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2.3.1. Vantagens:
Velocidade:
Simplicidade do hardware:
2.3.2. Desvantagens:
Qualidade de cdigo:
Expanso do cdigo:
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Como a arquitetura CISC trabalha com instrues nicas que possuem aes
complexas e a estrutura RISC trabalha com instrues, a transio de um cdigo entre as duas
estruturas pode acarretar problemas. Um cdigo originalmente compilado para uma mquina
CISC pode ter seu tamanho expandido consideravelmente quando recompilado para uma
mquina RISC.
Projeto de sistema:
A arquitetura RISC requer sistema de memria rpida para alimentar suas instrues e,
na maioria dos casos, sistemas baseados nessa arquitetura costumam apresentar grande
quantidade de memria Cache interna, encarecendo o projeto.
Portanto:
RISC CISC
Simplicidade Singularidade
Processadores mais baratos Processadores mais caros
Velocidade Complexidade
Maior nmero de dispositivos necessrios Executa imensas funes diferentes
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4. CONCLUSO
Diante do exposto neste trabalho, conclui-se que a arquitetura RISC constituda por
um conjunto de instrues simples, que contm sempre um nico tamanho e uma nica forma
de serem executadas, onde as instrues so executadas atravs de um nico ciclo, permitindo
que o processador execute vrias instrues ao mesmo tempo, proporcionando aos
processadores maior velocidade, devido a tecnologia denominada Pipelined, que uma
tcnica que permite ao hardware executar e processar vrias instrues ao mesmo tempo, no
precisando esperar o trmino de uma instruo para executar a outra. A arquitetura RISC
caracteriza-se por sua estrutura dinmica, simples, objetiva e de grande velocidade, pois
trabalha com um conjunto de instrues curtas e simples, alcanando grande performance,
que faz com que suas aplicaes tenham grande potencial em Sistemas de Rede, Internet e
Bancos de Dados. Esse fato somente se torna possvel, devido ao seu conjunto reduzido de
instrues, referente ao numero de ciclos de clock que o processador leva para executar entre
uma instruo e outra, permitindo a seleo e a execuo dessas instrues de forma paralela.
Mas toda arquitetura tem suas vantagens e desvantagens. Se de um lado, essa arquitetura
apresenta muitas qualidades, por outro pode se transformar num sistema de baixa performance
se no for projetado de forma correta. Os cdigos devem ser bem construdos e codificados
para alcanar um alto desempenho. As mquinas baseadas nessa arquitetura conquistam cada
vez mais o mercado de alto nvel, sendo responsvel por grande parte dos sistemas de grande
porte mundiais. A arquitetura CISC era dominante inicialmente, mas devido a melhoria das
memrias, as vantagens da CISC se perderam. Uma vez que RISC facilita a melhoria das
CPUs, ela torna-se a base de todas as CPUs Modernas.
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5. REFERNCIAS BIBLIOGRFICAS
SILVA, Hlcio Wagner da. Arquitetura de Computadores - Arquitetura RISC. Disponvel em:
<http://www2.ufersa.edu.br/portal/view/uploads/setores/110/arquivos/Arquitetura%20de
%20Computadores/RISC.pdf> Acesso em: 23 maio 2012.
MATTOS, Ndia Pdua de; RASKIN, Sara Fichman. Um comparativo RISC x PC: Aspectos
da Arquitetura de Processadores RISC. Disponvel em:
<http://www.batebyte.pr.gov.br/modules/conteudo/conteudo.php?conteudo=1259> Acesso
em: 24 maio 2012.