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    Este documento describe el diseño de un circuito comparador de 2 bits en Proteus usando compuertas lógicas. Incluye una tabla de verdad de 8 entradas que muestran los valores de entrada A y B y las 3 salidas que indican si A es igual, menor o mayor que B. También incluye las funciones reducidas de cada salida en términos mínimos y máximos. El objetivo final es diseñar e implementar este circuito comparador de 2 bits en Proteus.

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    1. Diseñar y simular en Proteus un circuito comparador de 8 bits empleando compuertas lógicas.

    Omitiremos la tabla de verdad ya que es muy grande.

    4. Diseñar y simular en Proteus un circuito comparador, al cual ingresen dos números A y B (de dos
    bits cada uno) y que tenga tres salidas, cada una de ellas conectadas a un led. Cada salida indicará si
    S0 (A = B ), S1 (A < B) o S2 (A > B). Debe elaborar:

     Tabla de verdad:

    Tablas de Verdad.
    𝐴0 𝐴1 𝐵0 𝐵1 𝑺𝟎 𝑺𝟏 𝑺𝟐
    0 0 0 0 1 0 0
    0 0 0 1 0 1 0
    0 0 1 0 0 1 0
    0 0 1 1 0 1 0
    0 1 0 0 0 0 1
    0 1 0 1 1 0 0
    0 1 1 0 0 1 0
    0 1 1 1 0 1 0
    1 0 0 0 0 0 1
    1 0 0 1 0 0 1
    1 0 1 0 1 0 0
    1 0 1 1 0 1 0
    1 1 0 0 0 0 1
    1 1 0 1 0 0 1
    1 1 1 0 0 0 1
    1 1 1 1 1 1 0
     Función reducida; expresada en min términos y máx. términos.

     𝑺𝟎 :

    𝑓 = ∑(0,5,10,15) = ∏(1,2,3,4,6,7,8,9,11,12,13,14)

     𝑺𝟏 :

    𝑓 = ∑(1,2,3,6,7,11,15) = ∏(4,5,8,9,10,12,13,14)

     𝑺𝟐 :

    𝑓 = ∑(4,8,9,12,13,14) = ∏(0,1,2,3,5,6,7,10,11,15)

     Diseño en proteus del comparador de 2 bits:

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