Arquitectura de Computadores
Clases 14 - 15
Rubn Mitnik
Objetivos
Captulo 4 : Unidad de Procesamiento Central (CPU)
Objetivos
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ndice
Captulo 4 : Unidad de Procesamiento Central (CPU)
4.1 Partes de la CPU. 4.2 Conjunto de Instrucciones y tipos de funcionalidad. 4.3 Ciclo de la Instruccin. 4.4 Diseo de una CPU bsica. 4.5 Modos de direccionamiento. 4.6 Instrucciones en lenguaje de mquina. 4.7 Subrutinas y Manejo de Stack. 4.8 Interrupciones de software y hardware. 4.9 CISC/RISC.
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Interrupciones
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Usos:
I/O
Errores
Ej. divisin por cero, Index out of range, page fault Error no previsto, puede ocurrir en cualquier momento.
Timer
Soporte para Sistema Operativo (task switching) Software
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Polling es ineficiente
Pueden ser muchos puertos. Estoy en otro loop y no reviso en el momento adecuado se pierde el dato.
Interrupciones
Programa sigue corriendo y solo busca el dato cuando le avisan que lleg. Busca solo en el puerto que lo interrumpi. No importa donde est en el cdigo.
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Con interrupciones
se mueve de inmediato y normalmente
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
1 Dispositivo: Teclado
direcciones
datos
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Secuencia:
Teclado interrumpe CPU termina instruccin CPU pide datos al teclado Teclado entrega datos Sigue pidiendo hasta que no queden ms datos CPU le dice que ya no siguen conversando
EOI
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
Teclado interrumpe CPU termina instruccin CPU ejecuta ISR asociado pregunta quien interrumpi al teclado Controlador lo que CPU vuelve ale responde por el haciendo antes estababus de datos
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
Teclado interrumpe CPU termina instruccin CPU pregunta quien interrumpi Controlador le responde por el bus de datos CPU ejecuta ISR asociado al teclado EOI al controlador Pasa a la siguiente interrupcin Cuando se acaben CPU vuelve a lo que estaba haciendo antes
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
8 Dispositivos
IMR: Interrupt Mask Register IRR: Interrupt Request Register ISR: In Service Register
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
PIC Dispositivo interrumpe CPU termina instruccin CPU pregunta quien manda INTA interrumpi PIC pone valor de por bus Controlador le dice la interrupcin en el bus de datos de datos CPU busca direccin de ISR en CPU ejecuta ISR asociado el teclado de interrupciones al vector EOI al controlador Pasa a la siguiente dispositivo interrupcin PIC Cuando se acaben
Vector de interrupciones
ISR IRQ3
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
PIC interrumpe CPU termina instruccin CPU manda INTA PIC pone valor de la interrupcin en el bus de datos CPU busca direccin de ISR en vector CPU ejecuta ISR asociado al dispositivo EOI al PIC Pasa a la siguiente interrupcin Cuando se acaben CPU vuelve a lo que estaba haciendo antes
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU) Int Int a IRQ0 IRQ1
CPU
8259 PIC
0x20
IRQ7
IRQ8 IRQ9
8259 8259
PIC 0xA0
PIC
IRQ15
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Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
Vector de interrupciones
PIC1: 0000 1xxx xxx : IRQ0-7 08 0F PIC2: 0111 0xxx xxx : IRQ8-15 70 77
Implementacin en Hardware
Captulo 4 : Unidad de Procesamiento Central (CPU)
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Implementacin en Software
Captulo 4 : Unidad de Procesamiento Central (CPU)
Sin int
Con int
Fetch
Exe
int
INT
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Resumen
Captulo 4 : Unidad de Procesamiento Central (CPU)
Resumen
Interrupciones
Qu son Usos Ventajas
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