ESCUELA: PONENTE: CIENCIAS DE LA COMPUTACIN Ing. Greyson Alberca Prieto I BIMESTRE Octubre Febrero 2009
BIMESTRE:
CICLO:
ulo
Contenidos
1. 2. 3. 4. Organizacin del Computador Componentes de computador y Buses Memoria Entrada/Salida
Alternativas HW y SW
Captulo II
Arquitectura de Computadores
Dentro de la CPU hay un conjunto de registros que ofrecen un nivel de memoria mas rapido y pequeo que la memoria principal. Registros visible al usuario. Registros de control y de estado. El registro visible al usuario es aquel que puede ser referenciado por medio del lenguaje maquina que ejecuta el procesador; accesible a todos los programas tanto los de aplicacin como los del sistema; los registros normalmente disponibles son: Registro de datos. Registros de direccion.
Registro indice
Puntero de segmento. Puntero Captulo II
depila
Arquitectura de Computadores
Captulo II
Arquitectura de Computadores
Sea una maquina hipotetica cuyas caracteristicas son : El procesador tiene un unico registro de datos el Acumulador(AC). Tanto las instrucciones como los datos son de 16 bits de longitud. El formato de instruccin dedica 4 (16 codigos de operacin diferentes)bits para el codigo de operacin y 12(4096=4K palabras) bits para direccionar la memoria directamente.
Ejemplo
Cod . Op.
3 4
Direccion
15 15
0 1 S
Registros internos de la CPU:
Magnitud
Contador de progarma(PC):direccion de la instruccin a ser leida. Registro de instruccin(IR):Instruccin que esta ejecutandose Acumulador(AC): Almacenamiento temporal
Arquitectura de Computadores 10
Captulo II
Ejemplo(cont.)
Lista parcial de los codigos de operacin: 0001 = Cargar de la memoria la acumulador. 0010 = Almacenar el AC en memoria. 0101 = Sumar al AC el contenido de la memoria
Memoria
300 301 302 940 941
Registros de la CPU
3 0 0 PC AC
1 5 2 . . . 0 0
9 4 0 9 4 1 9 4 1 . . . 0 0 3 0 0 2
1 9 4 0
IR
Ejemplo(cont.)
Los primeros 4 bits del IR indican que se cargara el AC, los 12 bits restantes indican la direccion.
Memoria
300 301 302 940 941
Registros de la CPU
3 0 0 0 0 0 3 1 9 4 0 PC AC
1 5 2 . . . 0 0
9 4 0 9 4 1 9 4 1 . . . 0 0 3 0 0 2
IR
Captulo II
Arquitectura de Computadores
12
Ejemplo(cont.)
Se incrementa el PC y se lee la instruccin siguiente
Memoria
300 301 302 940 941
Registros de la CPU
3 0 1 0 0 0 3 5 9 4 1 PC AC
1 5 2 . . . 0 0
9 4 0 9 4 1 9 4 1 . . . 0 0 3 0 0 2
IR
Captulo II
Arquitectura de Computadores
13
Ejemplo(cont.)
El contenido anterior del acumuladory el contenido dela ubicacin 941 se suman y el resultado se almacena en el AC
Memoria
300 301 302 940 941
Registros de la CPU
3 0 1 0 0 0 5 1 9 4 0 0003 + 0002 = 0005 PC AC
1 5 2 . . . 0 0
9 4 0 9 4 1 9 4 1 . . . 0 0 3 0 0 2
IR
Captulo II
Arquitectura de Computadores
14
Ejemplo(cont.)
Se incrementa el PC y se lee la instruccin siguiente.
Memoria
300 301 302 940 941
Registros de la CPU
3 0 2 0 0 0 5 2 9 4 1 PC AC
1 5 2 . . . 0 0
9 4 0 9 4 1 9 4 1 . . . 0 0 3 0 0 2
IR
Captulo II
Arquitectura de Computadores
15
Ejemplo(cont.)
El contenido de AC se almacena en la ubicacin 941. Son 3 ciclos de instruccin (c/u consta de un ciclo de lectura y otro de ejecucion)
Memoria
300 301 302 940 941
Registros de la CPU
3 0 2 0 0 0 5 1 9 4 0 PC AC
1 5 2 . . . 0 0
9 4 0 9 4 1 9 4 1 . . . 0 0 3 0 0 5
IR
Captulo II
Arquitectura de Computadores
16
Captulo II
Arquitectura de Computadores
17
Tipos de Instrucciones
La instruccin captada se almacena en el registro de instruccin (IR). El CPU interpreta la instruccin que puede ser en general del siguiente tipo: CPU-Memoria Transferir datos del CPU a la memoria o viceversa. CPU-ES Transferir datos a o desde el exterior mediante transferencias entre el CPU y un mdulo de E/S. Procesamiento de datos El CPU debe realizar alguna operacin aritmtica o lgica con los datos. Control Alteracin de la secuencia de ejecucin. Una instruccin puede implicar una combinacin de las acciones anteriores.
Captulo II Arquitectura de Computadores 18
Ejecucin de un Programa
Captulo II
Arquitectura de Computadores
19
Captulo II
Arquitectura de Computadores
20
Interrupciones
Programa Generada por alguna condicin como resultado de la ejecucin de una instruccin (desbordamiento, divisin por cero, instruccin no existente o acceso fuera del espacio de memoria). Termporizacin Generada por un temporizador interno al procesador para realizar una funcin de manera regular. E/S Generada por un controlador de E/S para indicar fin de operacin sin error o avisar una condicin de error. Fallo del hardware Generada por un fallo como deficiencia en alimentacin o error de paridad.
Captulo II
Arquitectura de Computadores
21
Ejecucin de Interrupciones
Captulo II
Arquitectura de Computadores
22
Captulo II
Arquitectura de Computadores
23
Captulo II
Arquitectura de Computadores
24
Captulo II
Arquitectura de Computadores
25
Captulo II
Arquitectura de Computadores
26
Tratamiento de Interrupciones
Captulo II
Arquitectura de Computadores
27
Interrupciones mltiples
Deshabilitar interrupciones
Definir Prioridades
Captulo II
Arquitectura de Computadores
28
Captulo II
Arquitectura de Computadores
29
Estructuras de Interconexin
Una computadora est constituida por un conjunto de unidades o mdulos de 3 tipos elementales (CPU, memoria y E/S) que se comunican entre s. Los conjuntos de lneas que conectan los diversos mdulos se denomina estructura de interconexin. El diseo de la estructura depende de los intercambios que se deban producir. Memoria Est constituido por palabras de la misma longitud, cada una de ellas con una nica direccin numrica. Mdulo de E/S Funcionalmente es similar a la memoria. Hay dos tipos de operaciones (lectura y escritura), puede controlar ms de un dispositivo externo. CPU Lee instrucciones y datos, escribe datos una vez que los ha procesado, y utiliza ciertas seales para controlar el funcionamiento del sistema.
Captulo II Arquitectura de Computadores 30
Tipos de transferencias
La estructura de interconexin debe dar cobertura a los siguientes tipos de transferencias: Memoria - CPU El CPU lee una instruccin o dato desde la memoria. CPU - Memoria El CPU escribe un dato en la memoria. E/S - CPU El CPU lee datos de un dispositivo de E/S a travs de un mdulo de E/S. CPU - E/S El CPU envo datos al dispositivo de E/S. Memoria - E/S y vicersa Se utiliza el acceso directo a memoria (DMA), no se pasa a travs del CPU.
Captulo II
Arquitectura de Computadores
31
Mdulos de la Computadora
Captulo II
Arquitectura de Computadores
32
Captulo II
Arquitectura de Computadores
34
Captulo II
Arquitectura de Computadores
35
Jerarqua de Buses
Las prestaciones de un bus van disminuyendo a medida que se van conectando un mayor nmero de dispositivos. Para optimizar el rendimiento de un bus se utilizan los buses organizados jerrquicamente, es por ello que tenemos:
Bus de arquitectura tradicional Bus de altas prestaciones.
Captulo II Arquitectura de Computadores 36
Tradicional
Captulo II
Arquitectura de Computadores
37
Tradicional
Captulo II
Arquitectura de Computadores
38
Sincrnico.- la presencia de un evento est determinada por l a presencia de un reloj Asincrnico.- la presencia de un evento en e l bus es consecuencia y d epende de que se produzca un evento previo Arquitectura de Computadores 39 no precisan la existencia de una seal de reloj
Conti
Anchura del bus Direccin.-el ancho de este bus afecta a la capacidad del sistema Datos.- mientras mas ancho es el bus de datos, mayor es el nmero de bits que se transmiten a la vez Tipo de transferencia de datos: Lectura Escritura Lectura-modificacin-escritura Lectura despus de escritura Bloque
Captulo II Arquitectura de Computadores 40
Temporizacin Sncrona
Captulo II
Arquitectura de Computadores
41
Temporizacin Asncrona
Captulo II
Arquitectura de Computadores
42
Temporizacin Asncrona
Captulo II
Arquitectura de Computadores
43
Arbitraje
CENTRALIZADO
DISTRIBUIDO
Captulo II
Arquitectura de Computadores
44
Transferencia datos
Captulo II
Arquitectura de Computadores
45
Ancho
Captulo II
Arquitectura de Computadores
46
Multiplexado/demultiplexado
Captulo II
Arquitectura de Computadores
47
Captulo II
Arquitectura de Computadores
48
Captulo II
Arquitectura de Computadores
49
Captulo II
Arquitectura de Computadores
50