DIGITAL
Arif Wibisono, S.Pd, M.Kom.
i
KATA PENGANTAR
S
elamat datang di buku Teknik Digital. Pada panduan ini, anda akan mempelajari
dasar-dasar serta konsep digital itu sendiri. Anda juga akan belajar menerapkan
dasar dan konsep digital tersebut kemudian memecahkan berbagai jenis
permasalahan yang berkaitan dengan digital. Pada dasarnya, panduan ini dibagi menjadi
delapan bab, yaitu Pengenalan Konsep Digital, Sistem Bilangan dan Kode, Rangkaian
Logika, Aljabar Boolean, Desain Rangkaian Logika, Rangkaian Aritmetik, Flip Flop,
serta Register dan Counter. Pada dua bab pertama adalah teori singkat tentang topik
utama yang dibahas. Sedangkan pada bab selanjutnya kita berlatih sekaligus mengenal
teorinya. Contoh-contoh soal pada panduan ini sudah saya susun sedemikian rupa
sehingga mudah membandingkan soal satu dengan lainnya sehingga muncul pemahaman
utuh
Buku ini disusun sebagai harapan agar menjadi panduan Mahasiswa dalam
mendalami digital, khususnya konsep digital itu sendiri maupun yang sedang mengambil
mata kuliah teknik digital.
Buku ini juga berisi beberapa contoh soal yang variatif, disesuaikan dengan
kebutuhan pengajaran.
Pada kesempatan ini, saya juga ingin mengucapkan terima kasih kepada
keluarga, istri utamanya yang selalu memberikan dorongan dan semangat. Juga ucapan
terima kasih kepada semua pihak yang telah membantu penerbitan buku ini baik secara
langsung maupun tidak langsung. Akhir kata, semoga buku ini dapat bermanfaat bagi
saya dan bagi para mahasiswa yang menempuh mata kuliah teknik digital.
Penyusun
ii
DAFTAR ISI
KATA PENGANTAR ...................................................................................................ii
DAFTAR GAMBAR .................................................................................................... vi
DAFTAR TABEL ......................................................................................................viii
BAB 1. PENGENALAN KONSEP DIGITAL ............................................................... 1
1.1. Representasi Bilangan ...................................................................................... 1
1.1.1. Representasi Analog ................................................................................. 1
1.1.2. Representasi Digital .................................................................................. 2
1.2. Kelebihan Dan Keterbatasan Sistem Digital ..................................................... 3
1.3. Sistem Bilangan Digital ................................................................................... 4
1.3.1. Sistem Desimal ......................................................................................... 4
1.3.2. Sistem Biner ............................................................................................. 5
1.4. Menyatakan Kuantitas-Kuantitas Biner ............................................................ 6
Soal Latihan ........................................................................................................... 7
BAB 2. SISTEM BILANGAN DAN KODE .................................................................. 9
2.1. Konversi Biner ke Desimal .............................................................................. 9
2.2. Konversi Desimal ke Biner .............................................................................. 9
2.3. Penjumlahan Biner......................................................................................... 11
2.4. Menyatakan Tanda Bilangan .......................................................................... 11
2.4.1. True Magnitude Form ............................................................................. 12
2.4.2. Bentuk Komplemen ke 1......................................................................... 13
2.4.3. Bentuk Komplemen Ke 2 ........................................................................ 13
2.4.4. Mengubah Bentuk Komplemen Menjadi Biner ....................................... 15
2.5. Penjumlahan Pada Sistem Komplemen ke 2 ................................................... 15
2.6. Pengurangan Dalam Sistem Komplemen Ke 2 ............................................... 17
2.7. Perkalian Bilangan-Bilangan Biner ................................................................ 18
2.8. Perkalian dalam sistem komplemen ke 2 ........................................................ 18
2.9. Pembagian Biner............................................................................................ 19
2.10. Sistem Bilangan Oktal ................................................................................ 19
2.10.1. Konversi Oktal ke Desimal.................................................................. 20
2.10.2. Konversi Biner ke Oktal / Oktal ke Biner ............................................ 20
2.10.3. Pembagian Secara Berulang ................................................................ 20
2.10.4. Keuntungan dari Sistem Oktal ............................................................. 21
2.11. Sistem Heksadesimal.................................................................................. 21
2.11.1. Konversi Heksadesimal ke Desimal..................................................... 22
2.11.2. Konversi Desimal ke Heksadesimal (dengan pembagian berulang) ...... 22
2.11.3. Konversi Biner ke Heksadesimal / Heksadesimal ke Biner .................. 22
2.11.4. Konversi Oktal ke Heksadesimal / Heksadesimal ke Oktal .................. 23
2.12. Penjumlahan Heksadesimal ........................................................................ 23
2.13. Kode BCD ................................................................................................. 23
2.13.1. Binary-Coded-Decimal Code .............................................................. 23
2.13.2. Perbandingan Antara Kode BCD dan Kode Biner................................ 24
iii
2.14. Penjumlahan BCD ...................................................................................... 25
2.14.1. Jumlah Samadengan Sembilan atau Kurang ........................................ 25
2.14.2. Jumlah Lebih Besar dari 9 ................................................................... 26
2.15. Kode Excess-3 ........................................................................................... 27
2.16. Kode Gray.................................................................................................. 28
2.16.1. Mengubah dari Gray Ke Biner............................................................. 30
SOAL LATIHAN .................................................................................................... 31
BAB 3. RANGKAIAN LOGIKA................................................................................. 34
3.1. Konstanta dan Variable Boolean .................................................................... 34
3.2. Operasi-Operasi Logika Boolean ................................................................... 35
3.2.1. Tabel Kebenaran ..................................................................................... 35
3.2.2. Operasi OR ............................................................................................. 36
3.2.3. OR gate .................................................................................................. 36
3.2.4. Operasi AND .......................................................................................... 37
3.2.5. AND gate ............................................................................................... 38
3.2.6. Operasi NOT .......................................................................................... 38
3.2.7. NOR Gate ............................................................................................... 39
3.2.8. NAND Gate ............................................................................................ 40
3.3. Sekilas tentang IC TTL .................................................................................. 41
SOAL LATIHAN .................................................................................................... 43
BAB 4. ALJABAR BOOLEAN ................................................................................... 47
4.1. Menguraikan Rangkaian-Rangkaian Logika Secara Aljabar ........................... 47
4.1.1. Rangkaian-rangkaian yang menggunakan Inverter .................................. 47
4.2. Mengevaluasi Output Rangkaian Logika ........................................................ 48
4.2.1. Penentuan Level Output Dari Suatu Diagram .......................................... 48
4.3. Implementasi Rangkaian-Rangkaian dari Ekspresi Boolean ........................... 49
4.4. Teorema-teorema Boolean ............................................................................. 50
4.4.1. Teorema Multivariabel............................................................................ 51
4.5. Teorema DeMorgan‟s .................................................................................... 51
4.5.1. Teorema DeMorgan‟s Tiga Variabel ....................................................... 52
4.5.2. Implikasi Teorema DeMorgan's .............................................................. 52
4.6. Keuniversalan dari NAND gate dan NOR gate............................................... 53
4.7. Representasi Alternative Gate Logika ............................................................ 54
4.8. Konsep dari Level-Level Logika Aktif ........................................................... 54
SOAL LATIHAN .................................................................................................... 55
BAB 5. DESAIN RANGKAIAN LOGIKA ................................................................. 59
5.1. Ekspresi-Ekspresi Sum-of-Products dan Product-of-Sums ............................. 59
5.2. Menurunkan Suatu Ekspresi Dari Suatu Tabel Kebenaran SOP ...................... 59
5.3. Rangkaian-Rangkaian Exclusive OR dan Exclusive NOR .............................. 61
5.3.1. Exclusive-OR ( EX-OR) : ....................................................................... 61
5.3.2. Exclusive-NOR ( EX-NOR) : ................................................................. 62
5.4. Metode Karnaugh Map .................................................................................. 63
5.4.1. Dua variabel ........................................................................................... 63
5.4.2. Tiga variabel ........................................................................................... 64
iv
5.4.3. Empat variabel ........................................................................................ 65
5.4.4. Lima variabel.......................................................................................... 65
5.4.5. Enam variabel input ................................................................................ 66
SOAL LATIHAN .................................................................................................... 67
BAB 6. RANGKAIAN ARITMETIK .......................................................................... 68
6.1. Unit Aritmetik ............................................................................................... 68
6.2. Penjumlah Biner Paralel................................................................................. 69
6.3. Penjumlah Biner Serial .................................................................................. 71
6.4. Rangkaian Penjumlah Biner ........................................................................... 73
6.4.1. Half Adder (HA) ..................................................................................... 73
6.4.2. Full Adder (FA) ...................................................................................... 74
6.5. Rangkaian Pengurang Biner ........................................................................... 77
6.5.1. Half Subtractor (HS) ............................................................................... 77
6.5.2. Full Subtractor (FS) ................................................................................ 79
6.6. Rangkaian Penjumlah/Pengurang ................................................................... 81
SOAL LATIHAN .................................................................................................... 83
BAB 7. FLIP-FLOP ..................................................................................................... 84
7.1. NAND Gate Latch ......................................................................................... 85
Reset .................................................................................................................... 86
7.2. NOR Gate Latch ............................................................................................ 86
Reset .................................................................................................................... 87
7.3. Pulsa Clock ( Sinyal Jam ) ............................................................................. 88
7.4. Clocked SR Flip-Flop .................................................................................... 89
7.5. Clocked JK Flop-Flop .................................................................................... 91
7.6. Clocked D Flip-Flop ...................................................................................... 93
7.7. T Flip-Flop .................................................................................................... 95
7.8. Flip-Flop Input Sinkron dan Asinkron ............................................................ 95
SOAL LATIHAN .................................................................................................... 96
BAB 8. REGISTER DAN COUNTER ......................................................................... 97
8.1. Register ......................................................................................................... 97
8.2. Counter ........................................................................................................ 100
8.2.1. Counter-Counter Asinkron .................................................................... 100
8.3. Modulo Number .......................................................................................... 102
8.3.1. Self-Stopping Ripple Counter ............................................................... 103
8.3.2. Counter-Counter dengan Sembarang/Setiap Mod Number .................... 103
8.3.3. Counter Sinkron.................................................................................... 104
SOAL LATIHAN .................................................................................................. 107
DAFTAR PUSTAKA ................................................................................................ 108
v
DAFTAR GAMBAR
Gambar 1. Diagram dari tegangan analog versus waktu ................................................. 2
Gambar 2. Diagram dari tegangan digital versus waktu .................................................. 3
Gambar 3. Diagram blok dari sistem kontrol temperature ............................................... 4
Gambar 4. Menggunakan saklar untuk menyatakan bilangan-bilangan biner .................. 6
Gambar 5. Bentuk sinyal digital ..................................................................................... 7
Gambar 6. Menyatakan Tanda Bilangan ....................................................................... 12
Gambar 7. Rangkaian logika dengan dua input A dan B ............................................... 35
Gambar 8. Simbol rangkaian untuk OR gate 2 input ..................................................... 36
Gambar 9. Simbol OR gate tiga input ........................................................................... 37
Gambar 10. Simbol AND gate dua input ...................................................................... 37
Gambar 11. AND dengan 3 input ................................................................................. 38
Gambar 12. Simbol NOT gate ...................................................................................... 39
Gambar 13. NOR Gate dua input ................................................................................. 39
Gambar 14. OR Gate tiga input yang disusun dari NOR gate dan NOT gate ................. 40
Gambar 15. NAND Gate dua input .............................................................................. 40
Gambar 16. SN74LS00 ................................................................................................ 41
Gambar 17. Rangkaian logika dengan ekspresi Booleannya ......................................... 47
Gambar 18. Rangkaian yang menggunakan inverter ..................................................... 47
Gambar 19. Penentuan level output .............................................................................. 49
Gambar 20. Membangun suatu rangkaian logika dari suatu ekspresi boolean ............... 50
Gambar 21. Universal NAND Gate .............................................................................. 53
Gambar 22. Universal NOR gate .................................................................................. 54
Gambar 23. Simbol Gate Logika Standar dan Simbol Ekivalennya .............................. 54
Gambar 24. Interprestasi dari dua symbol NAND Gate ................................................ 55
Gambar 25. AND Gate dengan input A‟ dan B............................................................. 60
Gambar 26. Rangkaian EX-OR, tabel kebenaran dan simbol ........................................ 61
Gambar 27. Rangkaian EX-NOR, tabel kebenaran dan simbol ..................................... 62
Gambar 28. Karnaugh Map dua variable ...................................................................... 63
Gambar 29. Diagram bagian-bagian fungsional dari unit aritmetik ............................... 69
Gambar 30. Contoh proses penjumlahan biner ............................................................. 70
Gambar 31. Diagram blok rangkaian adder pararel 4 bit yang menggunakan full adder 71
Gambar 32. Serial adder ............................................................................................... 72
Gambar 33. Blok diagram Half Adder .......................................................................... 73
Gambar 34. Rangkaian Half Adder .............................................................................. 74
Gambar 35. Blok diagram FA ...................................................................................... 74
Gambar 36. Full adder yang disusun dari 2 buah HA ................................................... 75
Gambar 37. Rangkaian FA ........................................................................................... 77
Gambar 38. Blok diagram Half Subtractor ................................................................... 78
Gambar 39. (a) Rangkaian HS tersusun dari EX-OR, AND dan NOT .......................... 79
Gambar 40. Blok Diagram FS ...................................................................................... 79
Gambar 41. Tabel kebenaran Full Subtractor ............................................................... 80
vi
Gambar 42. Rangkaian Full Subtractor......................................................................... 81
Gambar 43. Penjumlahan dan pengurangan dengan Kontrol Add/Sub .......................... 82
Gambar 44. Rangkaian adder/subtractor 4 bit ............................................................... 83
Gambar 45. Diagram sistem digital umum ................................................................... 84
Gambar 46. Simbol FF secara umum ........................................................................... 85
Gambar 47. NAND Gate Latch .................................................................................... 86
Gambar 48. NOR Gate Latch ....................................................................................... 87
Gambar 49. Pulsa Clock (Sinyal Jam) ......................................................................... 88
Gambar 50. Clocked SR Flip-Flop dengan pulsa clock aktif tinggi ............................... 89
Gambar 51. Bentuk-bentuk gelombang ........................................................................ 90
Gambar 52. Clocked SR Flip-Flop dengan pulsa clock aktif rendah ............................. 90
Gambar 53. Rangkaian Clocked SR Flip-Flop .............................................................. 91
Gambar 54. Clocked JK Flip-Flop................................................................................ 91
Gambar 55. Bentuk Gelombang ................................................................................... 92
Gambar 56. Rangkaian JK FF ...................................................................................... 93
Gambar 57. D FF yang ditrigger pada transisi menuju positif ....................................... 94
Gambar 58. Susunan JK FF yang bekerja sebagai D FF ............................................... 94
Gambar 59. D FF yang disusun dari NAND Gate ......................................................... 95
Gambar 60. T Flip Flop ................................................................................................ 95
Gambar 61. Clocked JK FF dengan input-input asinkron ............................................. 96
Gambar 62. Blok diagram register memori 4-bit .......................................................... 97
Gambar 63. Transfer data (a) mode seri, dan (b) mode pararel ..................................... 97
Gambar 64. Rangkaian register memori 4-bit ............................................................... 98
Gambar 65. Shift Register 4-bit .................................................................................... 99
Gambar 66. Register pararel input pararel output ....................................................... 100
Gambar 67. Counter Asinkron 4-bit ........................................................................... 101
Gambar 68. Self stopping ripple counter yang berhenti pada 1001 ............................. 103
Gambar 69. Mod-6 counter dengan meng-clear suatu mod-8 counter pada saat terjadi
hitungan ..................................................................................................................... 104
Gambar 70. Implementasi JK FF sebagai counter sinkron modulo-8 .......................... 107
vii
DAFTAR TABEL
Tabel 1. Hubungan antara heksadesimal, desimal dan biner ......................................... 21
Tabel 2. Representasi kode BCD dan kode Excess-3 .................................................... 27
Tabel 3. Representasi kode Gray dan Biner .................................................................. 29
Tabel 4. Level logika / Logic Level .............................................................................. 34
Tabel 5. Dengan operasi OR, 1+1=1, 1+1+1=1 ............................................................ 37
Tabel 6. Dengan operasi AND , 1*1 = 1, 1*1*1 = 1 ..................................................... 38
Tabel 7. Tabel kebenaran Half Subtractor .................................................................... 78
Tabel 8. Tabel kebenaran ............................................................................................. 86
Tabel 9. Tabel kebenaran ............................................................................................. 87
Tabel 10. Tabel Kebenaran .......................................................................................... 89
Tabel 11. Tabel kebenaran ......................................................................................... 102
Tabel 12. Tabel counter mod-8 binary counter ........................................................... 105
Tabel 13. Tabel exitasi untuk JK Flip-Flop................................................................. 105
Tabel 14 ..................................................................................................................... 105
viii
BAB 1. PENGENALAN KONSEP DIGITAL
Di dalam science, teknologi, bisnis dan pada semua bidang-bidang ilmu yang
lain, selalu berurusan dengan kuantitas . Kuantitas-kuantitas ini diukur, dimonitor,
dicatat, dan dimanipulasi secara aritmetik.
1
Gambar 1. Diagram dari tegangan analog versus waktu
2
Gambar 2. Diagram dari tegangan digital versus waktu
Secara sederhana perbedaan utama antara kuantitas analog dan kuantitas digital,
dapat dinyatakan sebagai berikut :
Analog = Continuous
Digital = Discrete (Step by Step)
3
apabila akan menggunakan teknik digital diperlukan langkah-langkah sebagai
berikut :
1. Ubahlah input yang masih dalam besaran analog menjadi bentuk digital
(Analog to Digital Converter atau ADC)
2. Selanjutnya proses dilakukan secara digital
3. Ubah output digital menjadi besaran analog (Digital to Analog Converter atau
DAC)
Diagram berikut menunjukkan sistem kontrol temperature
4
sebagai Most Significant Digit (MSD). 4 bobotnya paling kecil dan disebut Least
Significant Digit (LSD). Perhatikan contoh lain, 75.25. Bilangan ini sesungguhnya sama
dengan tujuh puluh plus lima satuan plus dua persepuluh plus lima perseratus.
103 102 101 100 10-1 10-2 10-3
=1000 =100 =10 =1 . =0.1 =0.01 =0.001
Most Decimal Least
Significant Point Significant
Digit (MSD) Digit (LSD)
5
101.11 2 1 22 0 21 1 20 1 21 1 22
4 0 1 0.5 0.250
5.75010
Tabel berikut menunjukkan urutan hitungan pada system bilangan biner.
6
Pada sistem-sistem digital elektronik, informasi biner dinyatakan oleh sinyal-
sinyal listrik yang terdapat pada input dan output dari berbagai macam rangkaian-
rangkaian elektronik. Dalam sistem ini, biner 0 dan 1 dinyatakan oleh dua tegangan
yang ekstrim berlawanan. Misalnya biner 0 dapat dinyatakan dengan harga nominal 0
volt dan biner 1 dinyatakan dengan 5 volt. Untuk lebih jelasnya perhatikan gambar 1.5
berikut.
Biner 1 : tegangan antara 2V sampai 5V
Biner 0 : tegangan antara 0V sampai 0.8 V
Tegangan antara 0.8V sampai 2V tidak digunakan, karena akan menyebabkan
kesalahan dalam rangkaian digital.
Soal Latihan
1. Apa perbedan antara besaran analog dan besaran digital ?
2. Berikut ini yang manakah menyatakan kuantitas analog dan manakah yang
digital?
a. Tekanan tabung
b. Perubahan temperatur dalam perioda 24 jam
c. Switch sepuluh-posisi
d. Skala penalaan radio
7
3. Ubahlah bilangan-bilangan biner berikut ini menjadi bilangan-bilangan
desimal:
a. 11001
b. 1001.101
c. 1011001
4. Sebutkan keuntungan-keuntungan dari teknik digital.
8
BAB 2. SISTEM BILANGAN DAN KODE
9
Untuk bilangan-bilangan desimal yang lebih besar, cara diatas menghabiskan
waktu. Suatu cara yang lebih mudah yaitu dengan melakukan pembagian berturut-turut
dengan 2 dan menuliskan sisanya sampai diperoleh hasil 0. Perhatikan contoh berikut :
bilangan desimal 25.375 dikonversi ke biner. Langkah yang pertama adalah memisahkan
bilangan bulat dengan pecahan. Konversi ini dilakukan dengan secara berturut-turut
membagi 25 dengan 2 dan menuliskan sisanya setiap pembagian sampai diperoleh hasil
bagi 0.
10
2.3. Penjumlahan Biner
Penjumlahan bilangan biner dilakukan sama seperti penjumlahan bilangan-
bilangan desimal. Dalam kenyataannya, penjumlahan biner lebih sederhana karena
hanya ada lebih sedikit kasus yang dipelajari. Berikut adalah penjumlahan desimal:
3 7 6
4 6 1
8 3 7
Langkah-langkah yang sama berlaku pula pada penjumlahan biner, tetapi
bagaimanapun juga hanya ada empat kasus yang terjadi pada penjumlaha biner pada
setiap posisi yaitu :
0+0=0
1+0=1
1 + 1 = 0 + carry 1 ke dalam posisi berikutnya
1 + 1 + 1 = 1 + carry 1 ke dalam posisi berikutnya
Kasus terakhir terjadi apabila pada suatu posisi tertentu ada 2 bit yang dua-
duanya 1 dan ada carry dari posisi sebelumnya. Berikut adalah contoh penjumlahan
biner :
0 1 1 (3) 1 0 0 1 (9) 1 1. 0 1 1 (3.375)
1 1 0 (6) 1 1 1 1 (15) 1 0. 1 1 1 (2.750)
1 0 0 1 (9) 1 1 0 0 0 (24) 1 1 0. 0 0 1 (6.125)
Penjumlahan adalah operasi aritmetik yang paling penting dalam sistem digital.
Operasi pengurangan, perkalian dan pembagian seperti yang dilakukan pada komputer
dan kalkulator digital sesungguhnya hanya menggunakan penjumlahan sebagai operasi
dasarnya.
11
menyatakan besarnya bilangan. Karena hampir semua komputer dan kalkulator digital
menangani bilangan-bilangan positip maupun bilangan-bilangan negatip, suatu cara
diperlukan untuk menyatakan tanda bilangan (+ atau -). Ini biasanya dilakukan dengan
menambahkan bit lain pada bilangannya yang disebut bit tanda atau sign bit . Konvensi
umum yang telah diterima adalah bahwa 0 pada sign bit menyatakan bilangan positip
dan 1 pada sign bit menyatakan bilangan negatip. Ini ditunjukkan pada gambar 6.
register A mengandung bit-bit 0110100. 0 pada bit paling kiri (A6) adalah sign bit yang
menyatakan positip. Enam bit yang lain menyatakan besarnya bilangan 1101002, yang
sama dengan 52 dalam desimal. Jadi bilangan yang disimpan dalam register A adalah
+52. Demikian juga, bilangan yang disimpan dalam register B adalah -31, karena sign
bitnya adalah 1 yang menyatakan negatip.
Sign bit digunakan untuk menunjukkan apakah bilangan biner yang disimpan
adalah positip atau negatip. Untuk bilangan-bilangan positip, bit-bit selebihnya (selain
sign bit) selalu digunakan untuk menyatakan besarnya bilangan dalam bentuk biner.
Tetapi untuk bilangan-bilangan negatip ada tiga bentuk yang digunakan untuk
menyatakan besarnya bilangan biner yaitu bentuk true-magnitude, bentuk komplemen ke
1, dan bentuk komplemen ke 2.
12
2.4.2. Bentuk Komplemen ke 1
Bentuk komplemen ke 1 dari setiap bilangan biner diperoleh dengan mengubah
setiap 0 di dalam bilangan tersebut menjadi 1, dan setiap 1 di dalam bilangan menjadi 0.
Dengan kata lain mengubah setiap bit menjadi komplemennya. Misalnya komplemen ke
1 dari 101101 adalah 010010, dan komplemen ke 1 dari 011010 adalah 100101.
Apabila bilangan-bilangan negatip dinyatakan dalam bentuk komplemen 1, sign
bitnya dibuat 1 dan besarnya dikonversikan dari bentuk biner sesungguhnya menjadi
komplemen ke 1-nya. Sebagai contoh bilangan -57 akan dinyatakan sebagai berikut :
Sign bit
-57 = 1 111001 (true magnitude form)
= 1 000110 (bentuk komplemen ke 1)
Ingat bahwa sign bit tidak dikomplemenkan tetapi dipertahankan tetap sebagai 1
untuk menunjukkan bilangan negatip. Berikut beberapa contoh tambahan dari bilangan-
bilangan negatip yang dinyatakan dalam bentuk komplemen ke 1.
000110
1 tambah 1 kepada LSB untuk membentuk komplemen ke 2
000111
13
Jadi, dalam representasi komplemen ke 2-nya dari – 57 akan ditulis sebagai
1000111. Juga disini, bit yang paling kiri merupakan sign bit. 6 bit yang lain merupakan
bentuk komplemen ke 2 dari besar bilangannya. Sebagai contoh lain komplemen ke 2
dari -14 ditulis 10010. Ketiga bentuk dari menyatakan bilangan-bilangan negatip untuk -
57 diikhtisarkan pada gambar dibawah:
1 1 1 1 0 0 1 True magnitude
1 0 0 0 1 1 0 Komplemen ke 1
1 0 0 0 1 1 1 Komplemen ke 2
Sign bit
Gambar diatas Tiga cara yang digunakan untuk menyatakan bilangan-bilangan
biner negative. Ketiga bentuk tersebut sekarang digunakan dalam sistem-sistem digital.
Beberapa mesin-mesin digital menyimpan bilangan-bilangan negatip dalam true
magnitude form, tetapi terlebih dahulu mengubahnya menjadi komplemen ke 1 atau
komplemen ke 2 sebelum mengerjakan setiap operasi-operasi aritmetik. Mesin-mesin
lain menyimpan bilangan-bilangan negatip dalam bentuk komplemen ke 1 dan
komplemen ke 2. Pada hampir semua mesin-mesin digital modern, untuk operasi-operasi
aritmetik bilangan-bilangan negatipnya ada dalam komplemen ke 1 atau bentuk
komplemen ke 2. Saat ini representasi komplemen ke 2 paling banyak digunakan.
Harus di ingat bahwa dalam ketiga sistem, true magnitude, komplemen ke 1 dan
komplemen ke 2, bilangan-bilangan positip selalu dalam bentuk biner sesungguhnya dan
dengan sign bit 0. Perbedaannya terletak pada representasi bilangan-bilangan
negatipnya.
Digunakannya bentuk-bentuk komplemen 1 dan komplemen 2 karena
penggunaannya memungkinkan untuk melakukan operasi pengurangan hanya dengan
menggunakan operasi penjumlahan. Ini penting karena berarti bahwa sebuah mesin
digital dapat menggunakan rangkaian yang sama untuk dua-duanya, menjumlahkan dan
mengurangkan, oleh karena itu menghemat tempat dan alat.
14
2.4.4. Mengubah Bentuk Komplemen Menjadi Biner
Untuk mengubah dari komplemen ke1 menjadi biner yang sebenarnya hanya
diperlukan untuk mengkomplemenkan lagi setiap bit-nya. Untuk mengubah dari
komplemen ke 2 menjadi biner yang sebenarnya hanya diperlukan untuk
mengkomplemenkan setiap bit dan kemudian menambah 1 pada LSB nya.
15
+5 10 0101
Carry ini diabaikan, sehingga hasilnya adalah 00101 = +5
Perhatikan bahwa sign bit-sign bit tersebut juga ikut dalam proses penjumlahan.
Ternyata sebuah carry dihasilkan pada posisi hasil penjumlahan terakhir. Carry ini selalu
diabaikan, sehingga jumlah akhir sama dengan 00101 (+5)
Kasus III : Bilangan Positip dan Bilangan Negatip yang Lebih Besar
Contoh penjumlahan -9 dan +4
-9 1 0111 (yang ditambah)
+4 0 0100 (yang menambah)
-5 1 1011 (jumlah = -5)
Disini jumlahnya mempunyai sign bit 1, yang menunjukkan suatu bilangan
negatip. Karena jumlahnya adalah negatip, maka merupakan bentuk komplemen ke 2,
sehingga empat bit terakhir (1011) menyatakan komplemen ke 2 dari 0101 (ekivalen
dengan desimal 5). Jadi 11011 adalah ekivalen dengan -5.
16
2.6. Pengurangan Dalam Sistem Komplemen Ke 2
Operasi pengurangan dengan menggunakan sistem komplemen ke 2
sesungguhnya melibatkan operasi penjumlahan dan sama sekali tidak berbeda dengan
berbagai macam kasus yang telah dibahas pada sub bab 1.9. Pada saat mengurangkan
satu bilangan biner dari bilangan biner yang lain, maka prosedurnya adalah sebagai
berikut :
Contoh :
Yang dikurangi (9) 01001
Pengurang (+4) 00100
17
diabaikan, sehingga hasilnya adalah 00101 = + 5
Perkalian yang dilakukan sama seperti yang dijelaskan di atas dengan catatan
bahwa bilangan yang dikalikan dan pengali dinyatakan dalam bentuk biner yang
sebenarnya . Apabila dua bilangan yang dikalikan adalah positip maka dapat dikalikan
sebagaimana mestinya. Tentu saja hasil kalinya adalah positip, dan diberi sign bit 0.
Apabila kedua bilangan tersebut negatip, terlebih dahulu dijadikan dalam bentuk
komplemen ke 2. masing-masing diubah menjadi bilangan positip dan kemudian
dikalikan. Hasilnya dipertahankan sebagai bilangan positip dan diberi sign bit 0. Apabila
salah satu dari kedua bilangan tersebut positip dan lainnya negatip, pertama-tama
bilangan negatip diubah menjadi bilangan positip dengan mencari komplemen ke 2-nya.
Hasilnya akan merupakan true magnitude form. Tetapi bagaimanapun juga, hasil kalinya
harus negatip, maka hasilnya kemudian diubah menjadi bentuk komplemen ke-2 dan
diberi sign bit 1.
18
2.9. Pembagian Biner
Proses untuk membagi suatu bilangan biner oleh bilangan biner lain adalah sama
dengan proses yang diikuti untuk bilangan-bilangan desimal, contoh :
0011 (9 : 3 = 3)
11 1001
011
0011
100 1010.0
100
100
100
0
19
83 82 81 80 8-1 8-2 8-3
=512 =64 =8 =1 . =1/8 =1/64 =1/512
Most Octal Point Least
Significant Significant
Digit (MSD) Digit (LSD)
Digit Oktal 0 1 2 3 4 5 6 7
Binary Ekivalen 000 001 010 011 100 101 110 111
Setiap digit oktal dinyatakan oleh tiga bit dari digit biner.
22/8 = 2 + sisa 6 6
20
Hasil 17710 = 2618
21
163 162 161 160 16-1 16-2 16-3
=4096 =256 =16 =1 . =1/16 =1/256 =1/4096
Most Hexadec. Least
Significant Point Significant
Digit (MSD) Digit (LSD)
23/16 = 1 + sisa 7 7
Hexadecimal Digit 0 1 2 3 4 5 6 7
Binary Equivalent 0000 0001 0010 0011 0100 0101 0110 0111
Hexadecimal Digit 8 9 A B C D E F
Binary Equivalent 1000 1001 1010 1011 1100 1101 1110 1111
Setiap digit heksadesimal dinyatakan dengan empat bit dari digit biner.
22
2.11.4. Konversi Oktal ke Heksadesimal / Heksadesimal ke Oktal
Contoh : Konversikan 5A816 ke Oktal .
= 2 6 5 0 (Oktal)
4 5 8 A 1 3
6 7 1 4 9 5
A C 9 E A 8
23
Karena digit desimal besarnya dapat mencapai 9, maka diperlukan 4 bit untuk mengkode
setiap digit (kode biner untuk 9 adalah 1001). Untuk menunjukkan kode BCD, ambil
bilangan desimal 874, setiap digit dapat diubah menjadi ekivalen binernya sebagai
berikut :
8 7 4
9 4 . 3
Dengan demikian, kode BCD menyatakan setiap digit bilangan desimal dengan
bilangan biner 4 bit. Jelaslah bahwa hanya digunakan bilangan-bilangan biner 4 bit dari
0000 sampai 1001.
BCD digunakan dalam mesin-mesin digital apabila yang diberikan sebagai input
atau di-display sebagai output adalah informasi digital. Voltmeter digital, pengukur
24
frekuensi, kalkulator, dan jam digital semuanya menggunakan BCD karena mereka
menyajikan informasi output dalam desimal.
BCD sering tidak digunakan dalam komputer digital berkecepatan tinggi, oleh
karena dua alasan. Pertama, BCD membutuhkan lebih banyak bit dibanding kode biner
langsung, oleh karena itu kurang efisien. Kedua, proses aritmetik untuk BCD lebih rumit
dibanding biner langsung sehingga memerlukan rangkaian yang lebih kompleks.
Semakin kompleks akan memperlambat kecepatan operasinya.
Contoh lain :
25
Pada contoh di atas tak satupun hasil penjumlahan dari digit-digit desimal
melampaui 9, oleh karena itu tidak dihasilkan carry-carry desimal. Untuk kasus-kasus ini
proses penjumlahan BCD adalah langsung dan sama dengan penjumlahan biner.
Hasil 1101 tidak terdapat dalam kode BCD , ini merupakan salah satu grup kode
4 bit terlarang. Ini terjadi karena jumlah dari dua bit tersebut melampui 9. Apabila ini
terjadi maka hasilnya harus dikoreksi dengan menambah 6 ( 0110) untuk menghindarkan
enam grup terlarang.
26
1000 0010 jumlah BCD yang benar
Tabel dibawah ini mencantumkan representasi kode BCD dan kode excess-3
untuk digit-digit desimal. Perhatikanlah bahwa kedua kode tersebut hanya menggunakan
10 dari 16 kemungkinan grup-grup kode 4-bit. Tetapi bagaimanapun juga, kode exces-3
tidak menggunakan grup-grup kode yang sama. Untuk excess-3, grup-grup kode yang
terlarang adalah 0000,0001,0010,1101,1111.
27
6 0110 1001
7 0111 1010
8 1000 1011
9 1001 1100
Kode Gray sering digunakan dalam situasi-situasi dimana kode-kode lain, seperti
misalnya biner, dapat memberikan hasil-hasil yang salah atau meragukan dalam transisi-
transisi dimana berubah lebih dari satu kode bit. Misalnya, dengan menggunakan kode
biner untuk naik dari 0111 ke 1000 membutuhkan keempat bit berubah secara serentak.
Tergantung kepada alat atau rangkaian yang menghasilkan bit, mungkin ada perbedaan
28
berarti (signifikan) dalam waktu-waktu transisi dari bit-bit yang berbeda. Apabila
demikian halnya, maka transisi dari 0111 menjadi 1000 dapat menghasilkan satu atau
lebih keadaan-keadaan intermediate.
Misalnya, apabila bit yang paling signifikan berubah lebih cepat dari yang
selebihnya, akan terjadi transisi-transisi seperti berikut ini :
29
Terjadinya 1111 hanya sesaat tetapi dapat menyebabkan kesalahan operasi dari
elemen-elemen yang sedang dikontrol oleh bit-bit. Jelaslah bahwa dengan menggunakan
kode Gray dapat meniadakan masalah ini, karena hanya terjadi satu perubahan bit per
transisi dan diantara bit-bit tidak terjadi race. Mengubah kode biner ke kode Gray :
Bit pertama dari kode Gray samadengan bit pertama dari bilangan biner
Bit kedua dari kode Gray samadengan exclusive-OR dari bit pertama dan
kedua dari bilangan biner, yaitu akan samadengan 1 apabila bit-bit kode
biner tersebut berbeda, 0 apabila sama.
Bit kode Gray ketiga samadengan exclusive-OR dari bit-bit kedua dan ketiga
dari bilangan biner, dan seterusnya.
30
1. Bit biner pertama adalah sama dengan bit kode Gray pertama
2. Apabila bit Gray kedua 0, bit biner kedua sama dengan yang pertama;
apabila bit gray kedua 1, bit biner kedua adalah kebalikan dari bit biner
pertama.
SOAL LATIHAN
31
75.573
NA
4. Konversikan (110101.1011)2 to desimal
53.6875
53.6375
52.6875
55.6375
NA
5. Konversikan (11001.1)2 to basis 8.
(62.4)8
(62.1)8
(31.1)8
(31.2)8
(31.4)8
6. Konversikan (25.6)8 ke biner.
(10101.11)2
(11101.10)2
(10101.10)2
(10010.11)2
(11111.01)2
7. Konversikan (35.1)8 ke basis 16.
(17.4)16
(1D.1)16
(D1.2)16
(E8.1)16
NA
8. Konversikan (39.A)16 ke basis 8.
(35.5)8
(70.5)8
(71.5)8
32
(72.25)8
(75.5)8
9. Konversikan (485)10 ke basis 16.
(1E5)16
(231)16
(5E1)16
(15E)16
NA
10. Konversikan (397)10 ke basis 3.
(12310)3
(121201)3
(012211)3
(112201)3
(100202)3
33
BAB 3. RANGKAIAN LOGIKA
Alat-alat digital dan rangkaian-rangkaian logika bekerja dalam sistem bilangan
biner; yaitu, semua variabel-variabel rangkaian adalah salah satu 0 atau 1 (rendah atau
tinggi). Karakteristik dari alat-alat digital ini membuatnya mungkin menggunakan
Aljabar Boolean sebagai suatu alat matematik untuk menganalisa dan mendisain
rangkaian-rangkaian dan sistem-sistem digital.
Kenyataannya bahwa hanya dua harga yang mungkin dalam aljabar boolean
membuat relatif mudah bekerja dengan aljabar boolean dibandingkan dengan aljabar
biasa. Dalam aljabar boolean tidak ada pecahan, desimal, bilangan negatif, akar pangkat
dua, akar pangkat tiga, logaritma, bilangan imajiner dan sebagainya. Kenyataannya,
dalam aljabar Boolean hanya ada tiga operasi dasar yaitu OR, AND, dan NOT.
34
Gerbang-gerbang logika ini merupakan rangkaian digital yang disusun dari
dioda, transistor dan resistor dimana output rangkaian merupakan hasil dari dasar
operasi logika (OR, AND, NOT).
Pada gambar berikut ditunjukkan suatu rangkaian logika yang mempunyai dua
input A dan B dengan output X.
35
Jika salah satu input A atau (OR) B berlogika 1, maka output X adalah 1. Maka
rangkian logika yang berada dalam kotak “?” adalah sebuah OR gate.
3.2.2. Operasi OR
Ekspresi X = A + B dapat dibaca sebagai ” X sama dengan A plus B ” atau ”
X sama dengan A atau B ”. Tanda + tidak menyatakan penjumlahan biasa, tetapi
menyatakan operasi OR, yang aturannya diberikan di dalam tabel yang ditunjukkan pada
gambar dibawah. Operasi OR menghasilkan output 1 jika salah satu input atau kedua-
nya berlogika 1. Operasi OR menghasilkan output 0 hanya jika semua input berlogika 0.
3.2.3. OR gate
Rangkaian digital OR gate adalah suatu rangkaian yang mempunyai dua input
atau lebih dan yang outputnya sama dengan operasi OR dari input. Gambar dibawah
menunjukkan symbol untuk suatu OR gate dua input. Input-input A dan B adalah level-
level tegangan logika dan output X adalah suatu level tegangan logika yang harganya
sama dengan hasil dari operasi OR dari A dan B; yaitu X = A + B. Dengan kata lain OR
gate tersebut bekerja sedemikian rupa sehingga outputnya tinggi (berlogika 1) jika salah
satu input A atau B atau dua-duanya berada pada level logika 1. Output OR gate tersebut
akan rendah (logika 0) hanya apabila semua inputnya berlogika 0.
36
Gambar 9. Simbol OR gate tiga input
37
3.2.5. AND gate
Suatu AND gate dua input ditunjukkan secara simbolis pada gambar 3.3. Output
AND gate sama dengan operasi AND dari input-inputnya yaitu, X = AB. Dengan kata
lain, AND gate adalah suatu rangkaian yang bekerja sedemikian rupa sehingga
outputnya adalah tinggi hanya apabila semua input-inputnya adalah tinggi. Untuk semua
kasus yang lain output AND gate adalah rendah.
38
X = A‟
Dimana ”garis-atas” atau tanda ”string” menyatakan operasi NOT. Ekspresi ini
dibaca ” X sama dengan inverse A” atau ” X sama dengan komplemen A”.
NOR gate ekivalen dari OR gate yang diikuti dengan inverter seperti ditunjukkan
pada gambar dibawah, sehingga ekspresi output untuk NOR gate dua input adalah :
X = ( A + B )'
39
Berikut suatu contoh OR gate tiga input yang disusun dari NOR gate diikuti
dengan NOT gate :
Gambar 14. OR Gate tiga input yang disusun dari NOR gate dan NOT gate
X = ( AB )'
40
3.3. Sekilas tentang IC TTL
Selama ini kita hanya mengenal symbol-symbol suatu gerbang logika. Di dalam
prakteknya suatu gerbang-gerbang logika ini dikemas dalam suatu IC (integrated
circuits). Salah satu diantaranya yang terkenal adalah TTL (transistor-transistor logic).
Setiap IC TTL ini mempunyai seri-seri tersendiri yang sudah ditetapkan oleh pabrik.
Untuk lebih jelasnya berikut ini adalah salah satu data book dari TTL seri 74 yaitu
SN74LS00.
Seri 74LS (low power dengan Scottky-clamp diodes), untuk seri yang sama
seperti seri 74L (low power) seri 74H (high power) dan seri 74S (fast speed).
Penggunaan scottky diodes dengan rangkaian transistor paling banyak memberikan
transistor switching tercepat karena waktu propagasinya terpendek, sedangkan 74H
memboroskan tenaga terbesar dan menangani arus output terbesar. IC TTL ini hanya
akan bekerja jika pin-pin power IC tersebut (GND untuk arus minus dan Vcc untuk arus
plus) dihubungkan dengan sumber tegangan.
41
42
SOAL LATIHAN
0
1
I don't know
NA
0
1
43
I don't know
NA
3. Untuk tiga input (A,B C) OR gate, logika apa yang dibutuhkan di input agar
output=0?
0
1
I don't know
NA
A=0,B=0,C=0
A=1, B=0, C=1
A=0, B=1, C=0
A=1, B=1, C=1
NA
44
Untuk soal 6 dan 7, perhatikan gambar berikut :
6. Apa logika output dari gambar di atas jika input A=0, B=1?
0
1
Not sure
NA
A=0, B=0
A=0, B=1
A=1, B=0
A=1, B=1
I don't know
A=0, B=0
A=0, B=1
A=1, B=0
A=1, B=1
I don't know
45
9. Perhatikan tabel kebenaran berikut, apa tipe gate yang sesuai dengan tabel
tersebut?
3 Inputs OR
3 Inputs AND
3 Inputs NOR
3 Inputs NAND
Not sure
46
BAB 4. ALJABAR BOOLEAN
47
4.2. Mengevaluasi Output Rangkaian Logika
Sekali ekspresi Boolean untuk suatu output rangkaian diperoleh, level logika dari
ouput dapat ditentukan untuk setiap harga –harga dari input-input rangkaian.
Berikut ini dua buah contoh untuk mengevaluasi output rangkaian logika :
48
Gambar 19. Penentuan level output
Setiap input OR gate adalah suatu term hasil operasi AND, yang berarti bahwa
suatu AND gate dengan multi input yang sesuai dapat digunakan untuk menghasilkan
tiap-tiap term ini. Ini ditunjukkan pada gambar dibawah ini.
49
Gambar 20. Membangun suatu rangkaian logika dari suatu ekspresi boolean
50
4.4.1. Teorema Multivariabel
x + xy = x (1+y)
= x * 1 [gunakan teorema (6)]
= x [gunakan teorema (2)]
51
dinyatakan, komplemen dari suatu penjumlahan OR sama dengan perkalian AND dari
komplemen-komplemennya.
Contoh :
X = [(A'+C) * (B+D')]'
= (A'+C)' + (B+D')' [dengan teorema (17)]
= (A''*C') + (B'+D'') [dengan teorema (16)]
= AC' + B'D
52
Untuk (17): (x*y)‟ = x‟ + y‟
Dengan cara yang sama, dapat ditunjukkan bahwa NOR gate dapat disusun untuk
melakukan setiap operasi Boolen.
53
Gambar 22. Universal NOR gate
54
Gambar 24. Interprestasi dari dua symbol NAND Gate
SOAL LATIHAN
x'y'+z
(x'+y')z
x'y'z
x'+y'+z
NA
x+y+z
x+y+z'
55
x'y'z
x'+y'+z'
NA
xz'+y
xz+y
x'z+y'
x'y'+y'z'
x'y'+y'z
AND
OR
NAND
NOR
None of the above
x(y'+z)
x(y'+z)
(y+x)(z'+x)
56
(y+x')(x'+z')
NA
AND
OR
NOT
AA (anyone is sufficient)
NAND
abcd
ab+cd
(a+b)(c+d)
a+b+c+d
(a'+b')(c'+d')
ACE'+BCE'+D'F
(A+B')(CE'D'F)
A+B+CE'D'F
ACE'+AD'F+B'CE'+B'D'F
NA
57
9. Fungsi dari rangkaian berikut adalah :
x'+y'+z'
x+y+z
x'z'+y'z'
xy+z
z
(A'+B')C+D'
(A+B')C'+D'
A'+(B'+C')D
A'+B'+C'+D'
A+B+C+D
58
BAB 5. DESAIN RANGKAIAN LOGIKA
Pada Bab ini akan dipelajari prosedur-prosedur dasar yang digunakan dalam
mendesain rangkaian-rangkaian logika apabila persyaratan-persyaratan yang diinginkan
diberikan. Persyaratan-persyaratan tersebut biasanya diberikan dalam salah bentuk tabel
kebenaran yang menunjukkan level output yang diinginkan untuk semua kombinasi-
kombinasi input. Pada rangkaian logika kombinatorial, output pada setiap saat waktu
tertentu hanya bergantung kepada level-level input yang ada pada saat itu.
Bentuk umum kedua adalah bentuk Product-of-Sums (POS) atau hasil kali-
jumlah, beberapa contohnya adalah sebagai berikut :
1. (A + B + C) . (C + D)
2. (A + B) . (C + D) . (E + F)
59
A B X
0 0 0
0 1 1
1 0 0
1 1 0
Latihan :
Rancanglah suatu rangkaian logika yang mempunyai tiga input, A, B, dan C.
Outputnya akan tinggi hanya apabila mayoritas dari input-inputnya tinggi.
Jawaban :
Langkah pertama adalah membuat tabel kebenaran berdasarkan persyaratan
tersebut
A B C X
0 0 0 0
0 0 1 0
0 1 0 0
0 1 1 1 A‟BC
1 0 0 0
1 0 1 1 AB‟C
1 1 0 1 ABC‟
1 1 1 1 ABC
60
Ekspresi SOP untuk X dapat ditulis sebagai :
X = A‟BC + AB‟C + ABC‟ + ABC
A B C
X = A’B + AB’
A A B X
X = A'B + AB'
B 0 0 0 A X
0 1 1
B
1 0 1
1 1 0
61
Tabel kebenarannya menunjukkan bahwa, output X = 1 untuk dua kasus : A = 0,
B = 1 dan A = 1, B = 0. Dengan kata lain, rangkaian ini menghasilkan output tinggi
apabila kedua inputnya berada pada level yang berlawanan.
X = AB + A’B’
A A B X
X = AB + A'B'
B
0 0 1 A X
0 1 0
B
1 0 0
1 1 1
62
X = AB + A’B’
2. Outputnya tinggi hanya apabila dua inputnya berada pada level yang sama.
Contoh :
63
Dengan menggunakan K-map, secara mudah dapat dilakukan penyederhanaan
fungsi logika, yaitu dengan cara membuat loop untuk output yang berlogika 1. Loop
dapat dilakukan untuk jumlah 2 n. Dari loop yang ada ternyata variabel A yang tidak
berubah sehingga secara langsung dapat ditulis ekspresi output : F = A
64
5.4.3. Empat variabel
Untuk empat variabel input dibutuhkan 24 map, seperti ditunjukkan pada gambar
berikut.
65
Dengan menggunakan K-map, ekspresi output dapat ditulis : X = A’B’E’ + CE
66
Untuk enam variabel input, dibuat map sejumlah 4x16.
SOAL LATIHAN
1. Susunlah suatu rangkaian logika yang outputnya tinggi hanya apabila A=1, B=0,
dan C=1
2. Susunlah suatu rangkaian logika yang outputnya tinggi hanya apabila A=0, B=1,
dan C=1
3. Rancanglah suatu rangkaian logika yang outputnya tinggi hanya apabila
mayoritas input A, B, dan C rendah.
4. Rancanglah rangkaian logika SOP yang sesuai dengan tabel kebenaran berikut :
A B C X
0 0 0 1
0 0 1 0
0 1 0 1
0 1 1 1
1 0 0 1
1 0 1 0
1 1 0 0
1 1 1 1
67
BAB 6. RANGKAIAN ARITMETIK
Fungsi terpenting dari hampir semua komputer dan kalkulator adalah melakukan
operasi-operasi aritmetik. Operasi-operasi ini semuanya dilaksanakan di dalam unit
aritmetik komputer, di dalam unit ini gate-gate logika dan flip-flop dikombinasikan
sedemikian rupa sehingga dapat melakukan operasi penjumlahan, pengurangan,
perkalian dan pembagian bilangan-bilangan biner. Pada bab ini akan dipelajari beberapa
rangkaian aritmetik dasar yang digunakan untuk melaksanakan operasi-operasi aritmetik
yang dibahas pada BAB V. dalam beberapa hal akan dibahas sampai proses desain yang
sebanarnya, meskipun rangkaian-rangkaian tersebut mungkin tersedia dipasaran dalam
bentuk rangkaian terintegrasi (IC), tujuan pembahasan ini adalah untuk memberikan
lebih banyak latihan dalam menggunakan teknik-teknik yang dipelajari pada BAB III.
Unit aritmetik paling sedikit mengandung dua buah flip-flop register : B register
dan accumulator register atau register pengumpul. Unit aritmetik juga mengandung
logika kombinatorial yang melaksanakan operasi-operasi aritmetik atas bilangan-
bilangan biner yang disimpan di dalam B register dan accumulator register.
68
2. Bilangan yang ditambahkan tersebut ditransfer dari memori menuju B
register
3. Bilangan di dalam B register dan bilangan di dalam accumulator register
dijumlahkan menjadi satu di dalam rangkaian-rangkaian logika. Jumlah yang
diperoleh kemudian dikirimkan ke accumulator untuk disimpan.
4. Bilangan baru di dalam accumulator tersebut dapat tetap tinggal di sana
sehingga bilangan lain dapat ditambahkan kepadanya, atau apabila proses
aritmetik tersebut telah selesai, hasilnya dapat di transfer ke memori untuk di
simpan.
69
Gambar 30. Contoh proses penjumlahan biner
70
Dengan demikian dapat dirancang suatu rangkaian logika yang dapat melakukan
proses ini hanya dengan menggunakan rangkaian-rangkaian identik untuk tiap-tiap
posisi bit. Ini ditunjukkan pada gambar dibawah ini.
Gambar 31. Diagram blok rangkaian adder pararel 4 bit yang menggunakan full adder
Rangkaian Full Adder yang digunakan pada tiap-tiap posisi mempunyai tiga
input: bit A, bit B, dan bit C, dan menghasilkan dua output : bit sum dan carry bit.
71
Pada penjumlahan seri proses penjumlahan dilakukan dengan cara yang kurang lebih
sama dengan cara yang dilakukan pada saat mengerjakan penjumlahan di atas kertas,
yaitu satu posisi demi satu posisi. Ini menghasilkan rangkaian yang jauh lebih sederhana
dibandingkan dengan penjumlahan paralel tetapi menghasilkan kecepatan operasi yang
jauh lebih lambat.
Gambar dibawah menunjukkan diagram dari sebuah adder serial 4-bit. Register
A dan B digunakan untuk menyimpan bilangan-bilangan yang akan dijumlahkan. Pada
adder seri register-register tersebut merupakan shift register yang harga-harga binernya
menggeser dari kiri ke kanan atas komando tiap pulsa clock. Output-output A0 dan B0
(LSB) diberikan ke dalam suatu rangkaian full adder tunggal bersama-sama dengan
output Q dari carry FF. Carry FF adalah FF tersendiri yang digunakan untuk menyimpan
carry out dari FA sehingga dapat dijumlahkan dengan posisi signifikan berikutnya dari
bilangan-bilangan di dalam register-register.
72
6.4. Rangkaian Penjumlah Biner
73
Half Adder dapat diimplementasikan dengan menggunakan EX-OR gate atau
susunan gate yang membentuk fungsi EX-OR untuk sum dan AND gate untuk carry.
Rangkaian HA dapat ditunjukkan pada gambar dibawah ini. untuk HA yang disusun dari
EX-OR dan AND dan gambar disebelahnya untuk HA yang disusun dari AND, OR dan
NOT gate.
(a) (b)
Gambar 34. Rangkaian Half Adder
74
Rangkaian FA dapat disusun oleh dua buah HA yang di-OR-kan.
Dari tabel kebenaran dapat dituliskan ekspresi logika untuk Sum dan carry :
75
Karnaugh map untuk Sum
76
Gambar 37. Rangkaian FA
77
Gambar 38. Blok diagram Half Subtractor
78
Berdasarkan persamaan logika tersebut di atas dapat digambarkan rangkaian HS:
(a) (b)
Gambar 39. (a) Rangkaian HS tersusun dari EX-OR, AND dan NOT
(b) Rangkaian HS dari AND, OR dan NOT
Masukan :
79
Gambar 41. Tabel kebenaran Full Subtractor
Masukan Keluaran
A B Borrow In Borrow- out Difference
0 0 0 0 0
0 0 1 1 1
0 1 0 1 1
0 1 1 1 0
1 0 0 0 1
1 0 1 0 0
1 1 0 0 0
1 1 1 1 1
Dari tabel kebenaran dapat dituliskan ekspresi logika untuk Dif dan Br-out :
80
Karnaugh map untuk Borrow-out
81
Seperti diketahui bahwa persamaan Sum pada penjumlahan 1 bit (FA)
sesungguhnya sama dengan Diffrence pada pengurangan 1 bit (FS),
Akan tetapi persamaan untuk carry_out dan Borrow_out adalah berlainan. Oleh
karena itu untuk membuat rangkaian dapat berfungsi sebagai penjumlah dan pengurang
perlu ditambah kontrol Add/Sub. Hal ini sebagai pemilih kapan rangkaian tersebut
memilih Carry_out atau Borrow_out. Kontrol Add/Sub ditunjukkan sebagai berikut :
82
Gambar dibawah ini memperlihatkan rangkaian adder/subtractor 4 bit :
SOAL LATIHAN
83
BAB 7. FLIP-FLOP
Sejauh ini rangkaian logika yang telah dibahas adalah rangkaian logika
kombinatorial yang level-level outputnya pada setiap saat tertentu tergantung kepada
level-level yang terdapat pada input-inputnya pada saat itu. Keadaan level input yang
terdahulu tidak mempunyai pengaruh terhjadap output-output yang kemudian karena
rangkaian kombinatorial tidak mempunyai memori. Sistem-sistem digital kebanyakan
terbuat dari dua-duanya, rangkaian-rangkaian kombinatorial dan elemen-elemen
memori.
Gambar dibawah ini menunjukkan diagram blok dari suatu system digital umum
yang menggabungkan gate-gate logika dengan elemen-elemen memori. Blok
kombinatorial menerima sinyal-sinyal logika dari input-input luar dan dari output-output
elemen-elemen memori.
84
Elemen memori yang paling banyak digunakan adalah Flip-Flop (FF). FF adalah
suatu rangkaian logika dengan dua output yang saling berlawanan. Gambar dibawah ini
menunjukkan symbol flip-flop secara umum.
Untuk FF ada dua keadaan kerja yang mungkin : (1) Q = 0, Q‟=1 : dan (2) Q =
1, Q‟ = 0 . FF mempunyai satu input atau lebih yang digunakan untuk mengoperasikan
FF bolak-balik antara dua keadaan tersebut. Sekali sebuah sinyal input mengoperasikan
FF menuju suatu keadaan tertentu, FF tersebut akan tetap berada pada keadaan itu
meskipun setelah sinyal inputnya terputus. Ini adalah karakteristik memori dari
rangkaian FF.
85
Gambar 47. NAND Gate Latch
86
S, maka kondisi ini menyebabkan FF di set ke 1 (Q=1). Jika logika 1 diberikan ke input
R, maka kondisi ini menyebabkan FF di reset ke 0 (Q=0).
87
7.3. Pulsa Clock ( Sinyal Jam )
Hampir semua system digital beroperasi sebagai system-sistem urutan sinkron
atau synchronous sequential system. Yang dimaksud adalah bahwa urutan operasi
disinkronisasikan oleh suatu pulsa yang disebut pulsa clock. Pulsa clock yaitu pulsa-
pulsa periodik yang biasanya berbentuk bujur sangkar (duty cycle 50%), seperti yang
ditunjukkan pada gambar 49.
88
7.4. Clocked SR Flip-Flop
Gambar 50 menunjukkan sebuah clocked SR flip-flop yang dikomando oleh sisi
menuju positip dari pulsa clock. Ini berarti bahwa FF akan mengubah keadaan hanya
apabila suatu sinyal diberikan kepada clock inputnya (disingkat CLK atau C )
melakukan suatu transisi dari 0 ke 1. Input-input S dan R mengontrol keadaan FF
dengan cara yang sama seperti yang diuraikan pada SR FF dasar (tanpa clock), tetapi FF
tersebut tidak akan memberikan respon kepada input-input ini sampai saat terjadinya
transisi sisi naik dari pulsa clock. Ini ditunjukkan oleh bentuk gelombang pada gambar
51.
89
Gambar 51. Bentuk-bentuk gelombang
Dari gambar 51 terlihat bahwa output FF tidak terpengaruh oleh sisi menuju
negatip dari pulsa clock. Juga perhatikan bahwa level-level S dan R tidak mempunyai
pengaruh terhadap FF kecuali pada saat terjadi transisi menuju positip dari pulsa clock.
Input-input S dan R pada hakekatnya adalah input-input pengontrol, yang mengontrol
ke keadaan mana output FF apabila terjadi pulsa clock. Clock input adalah trigger input,
yang sesungguhnya menyebabkan berubahnya keadaan FF sesuai dengan level dari
input-input S dan R.
S Q
1
CLK
0
R Q'
90
Rangkaian internal Clocked SR FF dalam kenyataannya sudah ada dalam bentuk
IC, rangkaiannya terdiri dari dua bagian yaitu :
1. NAND latch yang disusun oleh NAND-3 dan NAND-4
2. Rangkaian pulsa yang disusun oleh NAND-1 dan NAND-2
SET U1
U3
Q
NAND2
CLOCK NAND2
U4
U2
RESET
NAND2
Q'
NAND2
Bekerjanya FF ini ditunjukkan oleh bentuk gelombang pada gambar 54, yang
dapat dianalisa sebagai berikut :
1. Mula-mula semua input adalah 0 dan output Q sama dengan 1.
91
2. Apabila terjadi sisi menuju positip dari pulsa clock pertama berlangsung
pada kondisi J=0 dan K=1, maka output Q=0
3. Pulsa clock kedua mendapatkan J=0 dan K=0 pada saat melakukan transisi
positipnya, ini menyebabkan output Q tetap pada kondisi sebelumnya yaitu
Q=0.
4. Pulsa clock ketiga mendapatkan J=1 dan K=0 pada saat melakukan transisi
positipnya, ini menyebabkan output Q=1.
5. Pulsa clock keempat mendapatkan J=1 dan K=1 pada saat melakukan
transisi positipnya, ini menyebabkan FF toggle sehingga output Q
berlawanan dari kondisi sebelumnya , yaitu menjadi Q=0.
1
CLOCK 1 2 3 4
0
1
J
0
1
K
0
1
Q
0
92
U5
U1
U3
J Q
AND2
NAND2
NAND2
CLOCK
U4
U2
U6
K
NAND2
Q'
NAND2
AND2
Perhatikanlah bahwa setiap terjadi transisi positip pada CLK inputnya, output Q
memiliki harga yang sama seperti pada yang terdapat pada level D input. Transisi
negatip pada CLK input tidak mempunyai pengaruh.
93
Gambar 57. D FF yang ditrigger pada transisi menuju positif
D FF juga dapat dibentuk dari NAND gate seperti ditunjukkan pada gambar 59
berikut :
94
Gambar 59. D FF yang disusun dari NAND Gate
7.7. T Flip-Flop
T FF dapat dibentuk dari modifikasi Cloked SR FF, D FF, maupun JK FF. Pada
gambar di bawah ditunjukkan modifikasi JK FF yang digunakan sebagai T FF. Masukan
J dan K pada JK FF dihubungkan dengan logika “1” atau dalam praktek dihubungkan
dengan VCC +5 Volt, sedangkan sebagai masukan T FF adalah clock pada JK FF.
Keadaan output akan Q berubah setiap ada pulsa clock.
95
Gambar 61. Clocked JK FF dengan input-input asinkron
SOAL LATIHAN
96
BAB 8. REGISTER DAN COUNTER
8.1. Register
Dalam elektronika digital seringkali diperlukan penyimpan data sementara
sebelum data diolah lebih lanjut. Elemen penyimpan dasar adalah flip-flop. Setiap flip-
flop menyimpan sebuah bit data. Sehingga untuk menyimpan data n-bit, diperlukan n
buah flip-flop yang disusun sedemikian rupa dalam bentuk register. Suatu memori
register menyimpan data 1001 dapat ditunjukkan secara blok diagram seperti gambar 62.
Data biner dapat dipindahkan secara seri atau parallel (lihat gambar 63)
Gambar 63. Transfer data (a) mode seri, dan (b) mode pararel
Dalam metode seri, bit-bit dipindahkan secara berurutan satu per satu : b0, b1,
b2, dan seterusnya. Dalam mode paralel, bit-bit dipindahkan secara serempak sesuai
97
dengan cacah jalur paralel (empat jalur untuk empat bit) secara sinkron dengan sebuah
pulsa clock. Ada empat cara dimana register dapat digunakan untuk menyimpan dan
memindahkan data dari satu bagian ke bagian sistem yang lain :
1. Serial input paralel output ( SIPO )
2. Serial input serial output ( SISO )
3. Paralel input parallel output ( PIPO )
4. Paralel input serial output ( PISO )
Beberapa tipe flip-flop dapat digunakan untuk membuat suatu register. Jika D FF
digunakan untuk membentuk register memori 4-bit, susunannya dapat dilihat pada
gambar 64.
Pada gambar 64 ditunjukkan sebuah register memori 4 bit yang terdiri dari 4
buah D FF. Data input dimasukkan secara paralel pada terminal A, B, C, dan D. Data
pada input akan di transfer ke output setiap ada pulsa clock secara paralel juga. Karena
data input masuk secara paralel dan output juga secara paralel maka rangkaian di atas
disebut sebagai Paralel Input dan Paralel Output (PIPO).
Data yang disimpan pada rangkaian 64 tidak dapat digeser dari satu D FF ke D
FF yang lainnya. Jika output QA dihubungkan ke input B, data akan di geser dari kiri ke
kanan yang dikenal sebagai shift register, seperti ditunjukkan pada gambar 65.
98
Misalkan QA dan QB diset awal ke 0. Bit pertama dimasukkan ke input flip-flop
A, jika ada clock pertama, bit tersebut akan di transfer ke output QA. Bit pertama
sekarang telah tersambung ke input B, dan bit ke dua dari data input terhubung ke input
flip-flop A. Jika ada pulsa clock kedua, bit pertama berpindah ke output QB dan bit
kedua berpindah ke output QA. Proses perpindahan data akan berlanjut sampai 4-bit.
Data dapat dibaca secara paralel dari QA, QB, QC, dan QD secara simultan, dikenal
sebagai Serial Input Serial Output (SISO).
Shift register juga dapat disusun dari SR FF atau JK FF, dengan penambahan
fasilitas Preset dan Clear. Rangkaian dapat digunakan untuk serial input maupun paralel
input. Untuk paralel input dan paralel output dapat ditunjukkan pada gambar 66.
99
Gambar 66. Register pararel input pararel output
8.2. Counter
Pada bagian ini akan dibahas bagaimana flip-flop dapat digunakan di dalam
counter biner sedemikian rupa hingga keadaan-keadaan output FF menyatakan suatu
bilangan biner yang sama dengan jumlah pulsa-pulsa clock yang dating. Pada bagian ini
akan dipelajari beberapa jenis rangkaian counter yang paling luas penggunaannya secara
mendetail. Meskipun rangkaian – rangkaian tersebut tersedia sebagai IC, namun operasi
internalnya masih patut mendapat perhatian karena pentingnya teknik-teknik dan
prinsip-prinsip yang digunakan dan dapat diperluas untuk pemakaian-pemakaian lain.
100
2. Output FF A berfungsi sebagai CLK input untuk FF B, sehingga FF B akan
toggle setiap saat output A berubah dari 1 ke 0. Demikian juga FF C akan
toggle pada saat B berubah dari 1 ke 0 dan FF D akan toggle apabila C
berubah dari 1 ke 0.
3. Tabel 8.1 menunjukkan urutan keadaan-keadaan biner, dengan D sebagai
MSB dan A sebagai LSB maka akan dihasilkan urutan counting biner dari
0000 sampai 1111.
4. Setelah terjadi pulsa ke 15, counter FF berada dalam keadaan 111. Atas
komando pulsa clock yang ke 16 FF A beruabah dari 1 ke 0, yang
menyebabkan FF B berubah dari 1 ke 0, dan seterusnya sampai counter
berada dalam keadaan 0000. Dengan kata lain, counter tersebut telah
melewati satu cycle lengkap dan telah recycled kembali ke 0000, dimana
counter akan mulai suatu cycle counting baru apabila diberikan pulsa-pulsa
clock berikutnya.
Jenis counter ini dikenal sebagai counter asinkron. Karena kerjanya saling
menunggu, maka terjadi penundaan antara respond dari setiap FF. Pada FF modern
penundaan ini sangat kecil (10-40 ns), tapi dalam beberapa hal penundaan ini dapat
menyulitkan. Dikarenakan cara bekerjanya, jenis counter ini juga umum dikenal sebagai
ripple counter.
101
Tabel 11. Tabel kebenaran
0 0 0 0 0
0 0 0 1 1
0 0 1 0 2
0 0 1 1 3
0 1 0 0 4
0 1 0 1 5
0 1 1 0 6
0 1 1 1 7
1 0 0 0 8
1 0 0 1 9
1 0 1 0 10
1 0 1 1 11
1 1 0 0 12
1 1 0 1 13
1 1 1 0 14
1 1 1 1 15
0 0 0 0 16 ( recycles )
0 0 0 1 17
0 0 1 0 18
0 0 1 1 19
0 1 0 0 20
0 1 0 1 21
102
Dimana N adalah jumlah FF yang dihubungkan dalam susunan counter.
Misalnya apabila digunakan lima FF, maka akan didapatkan mod-32 counter (25 = 32),
yang berarti memiliki 32 kedudukan yang berbeda (00000 sampai 11111).
103
membuat counter tersebut menjadi apa yang disebut skip states. Satu contoh ditunjukkan
pada gambar 69.
104
Counter modulo-8 membutuhkan tiga buah flip-flop, yang mampu mencacah dari
000 sampai 111 dan berulang. Runtutan cacahan ditunjukkan pada tabel 12.
Tabel 12. Tabel counter mod-8 binary counter
Present State Next State
A B C A+ B+ C+
0 0 0 0 0 1
0 0 1 0 1 0
0 1 0 0 1 1
0 1 1 1 0 0
1 0 0 1 0 1
1 0 1 1 1 0
1 1 0 1 1 1
1 1 1 0 0 0
Untuk menganalisis lebih lanjut harus diingat tabel exitasi dari JK FF, seperti
ditunjukkan pada tabel 13.
Tabel 13. Tabel exitasi untuk JK Flip-Flop
Present Next Input
State State
Q Q+ J K
0 to 0 0 x
0 to 1 1 x
1 to 1 x 0
1 to 0 x 1
105
Dari tabel di atas dibuat peta karnaugh untuk input J dan K :
106
Gambar 70. Implementasi JK FF sebagai counter sinkron modulo-8
SOAL LATIHAN
107
DAFTAR PUSTAKA
Depari, G. 2011. TEKNIK DIGITAL teori dan aplikasi . Bandung : NUANSA AULIA,
2011.
108